The SN65LVDS302 receiver de-serializes FlatLink™3G compliant serial input data to 27 parallel data outputs. The SN65LVDS302 receiver contains one shift register to load 30 bits from 1, 2 or 3 serial inputs and latches the 24 pixel bits and 3 control bits out to the parallel CMOS outputs after checking the parity bit. If the parity check confirms correct parity, the Channel Parity Error (CPE) output remains low. If a parity error is detected, the CPE output generates a high pulse while the data output bus disregards the newly-received pixel. Instead, the last data word is held on the output bus for another clock cycle.

• Serial interface technology
• Compatible with FlatLink3G such as SN65LVDS301
• Supports video interfaces up to 24-bit RGB data and 3 control bits received over 1, 2 or 3 SubLVDS differential lines
• SubLVDS differential voltage levels
• Up to 1.755-Gbps Data Throughput
• Three operating modes to conserve power
  • Active mode QVGA: 17 mW
  • Typical shutdown: 0.7 W
  • Typical standby mode: 27 W Typical
• Bus-swap function for PCB-layout flexibility
• ESD rating > 4 kV (HBM)
• Pixel clock range of 4 MHz to 65 MHz
• Failsafe on all CMOS inputs
• Packaged in 5-mm × 5-mm nFBGA with 0.5-mm ball pitch
• Very low EMI meets SAE J1752/3 ’Kh’-spec

• Function
• Deserializer
• Protocols
• Channel-Link I
• Supply voltage (V)
• 1.8
• Signaling rate (Mbps)
• 1755
• Input signal
• LVDS
• Output signal
• CMOS
• Rating
• Catalog
• Operating temperature range (C)
• -40 to 85

SN65LVDS302的完整型号有：SN65LVDS302ZXH、SN65LVDS302ZXHR，以下是这些产品的关键参数及官网采购报价：

SN65LVDS302ZXH，工作温度：-40 to 85，封装：NFBGA (ZXH)-80，包装数量MPQ：576个，MSL 等级/回流焊峰值温度：Level-3-260C-168 HR，引脚镀层/焊球材料：SNAGCU，TI官网SN65LVDS302ZXH的批量USD价格：1.2（1000+）

SN65LVDS302ZXHR，工作温度：-40 to 85，封装：NFBGA (ZXH)-80，包装数量MPQ：2500个，MSL 等级/回流焊峰值温度：Level-3-260C-168 HR，引脚镀层/焊球材料：SNAGCU，TI官网SN65LVDS302ZXHR的批量USD价格：1（1000+）

SN65LVDS302 IBIS Model

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如需获取可用 TINA-TI 模型的完整列表，请参阅：SpiceRack - 完整列表

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